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组合逻辑电路测试的目的是验证其逻辑功能是否符合设计要求，也就是验证其输出与输入的关系是否与真值表相符。
静态测试是在电路静止状态下测试输出与输入的关系。将输入端分别接到逻辑开关上，用发光二极管分别显示各输入端和输出端的状态。按真值表将输入信号一组一组地依次送入被测电路，测出相应的输出状态，与真值表相比较，借以判断此组合逻辑电路静态工作是否正常。
动态测试是测量组合逻辑电路的频率响应。在输入端加上周期性信号，用示波器观察输入、输出波形。测出与真值表相符的最高输入脉冲频率。
时序逻辑电路测试的目的是验证其状态的转换是否与状态图相符合。可用发光二极管、数码管或示波器等观察输出状态的变化。
常用的测试方法有以下两种：
以单脉冲源作为时钟脉冲，逐拍进行观测。
以连续脉冲源作为时钟脉冲，用示波器观察波形，以判断输出状态的转换是否与状态图相符。