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2.2 Vivado功能和特性 |
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Vivado Design Suite提供全新构建的SoC增强型、以IP和系统为中心的下一代开发环境，以解决系统级集成和实现的生产力瓶颈。
与Xilinx前一代的设计平台ISE相比，在各方面的性能都有了明显的提升。表2.1给出了Vivado在性能方面的提升。
表2.1 Vivado Design Suite加速设计生产力
Vivado集成设计环境支持下面业界已经建立的设计标准：
（1）Tcl。
（2）AXI4，IP-XACT。
（3）Synopsys设计约束（Synopsys Design Constraints，SDC）。
（4）Verilog、VHDL、SystemVerilog。
（5）SystemC、C、C++。
通过这些支持，使得：
（1）通过对工业标准的支持，使得电子设计自动化（Electronic Design Automation，EDA）生态系统更好地支持Vivado设计套件。此外，Vivado设计套件中集成了很多新的第三方工具。
（2）本质上，Vivado设计套件是基于Tcl的，支持Synopsys设计约束（SDC）和Xilinx设计约束（Xilinx Design Constraints，XDC）格式。
（3）除了提供传统上对Verilog、VHDL和SystemVerilog综合的支持，Vivado高级综合HLS可以使用C、C++或者SystemC语言定义逻辑。
（4）使用标准的IP互连协议，比如：AXI4和IP-XACT，使得更快和更容易的系统级设计集成。